电工电子技术基础（第二版）课件第11章组合逻辑电路.ppt

1、二进制、二进制与十进制的相互转换逻辑代数的公式与定理、逻辑函数化简逻辑门电路的逻辑符号及逻辑功能组合电路的分析方法和设计方法典型组合逻辑电路的功能11.1.1 数字信号与数字电路数字信号与数字电路模拟信号：在时间上和数值上连续的信号。数字信号：在时间上和数值上不连续的（即离散的）信号。uu模拟信号波形数字信号波形tt对模拟信号进行传输、处理的电子线路称为模拟电路。对数字信号进行传输、处理的电子线路称为数字电路。（1）工作信号是二进制的数字信号，在时间上和数值上是离散的（不连续），反映在电路上就是低电平和高电平两种状态（即0和1两个逻辑值）。（2）在数字电路中，研究的主要问题是电路的逻辑功能，即

2、输入信号的状态和输出信号的状态之间的逻辑关系。（3）对组成数字电路的元器件的精度要求不高，只要在工作时能够可靠地区分0和1两种状态即可。（1）进位制：表示数时，仅用一位数码往往不够用，必须用进位计数的方法组成多位数码。多位数码每一位的构成以及从低位到高位的进位规则称为进位计数制，简称进位制。11.1.2 数制数制（2）基 数：进位制的基数，就是在该进位制中可能用到的数码个数。（3）位 权（位的权数）：在某一进位制的数中，每一位的大小都对应着该位上的数码乘上一个固定的数，这个固定的数就是这一位的权数。权数是一个幂。数码为：09；基数是10。运算规律：逢十进一，即：9110。十进制数的权展开式：(

3、1)、十进制、十进制103、102、101、100称为十进制的权。各数位的权是10的幂。同样的数码在不同的数位上代表的数值不同。任意一个十进制数都可以表示为各个数位上的数码与其对应的权的乘积之和，称权展开式。即：(5555)105103 510251015100又如：(209.04)10 2102 0101910001014 102(2)、二进制、二进制数码为：0、1；基数是2。运算规律：逢二进一，即：1110。二进制数的权展开式：如：(101.01)2 122 0211200211 22(5.25)10加法规则：0+0=0，0+1=1，1+0=1，1+1=10乘法规则：0.0=0，0.1=0

4、，1.0=0，1.1=1运算运算规则规则各数位的权是的幂各数位的权是的幂二进制数只有0和1两个数码，它的每一位都可以用电子元件来实现，且运算规则简单，相应的运算电路也容易实现。数码为：07；基数是8。运算规律：逢八进一，即：7110。八进制数的权展开式：如：(207.04)10 282 0817800814 82 (135.0625)10(3)、八进制、八进制(4)、十六进制、十六进制数码为：09、AF；基数是16。运算规律：逢十六进一，即：F110。十六进制数的权展开式：如：(D8.A)2 13161 816010 161(216.625)10各数位的权是各数位的权是8的幂的幂各数位的权是各

5、数位的权是16的幂的幂结论结论一般地，N进制需要用到N个数码，基数是N；运算规律为逢N进一。如果一个N进制数M包含位整数和位小数，即 (an-1 an-2 a1 a0 a1 a2 am)2则该数的权展开式为：(M)2 an-1Nn-1 an-2 Nn-2 a1N1 a0 N0a1 N-1a2 N-2 amN-m 由权展开式很容易将一个N进制数转换为十进制数。几几种种进进制制数数之之间间的的对对应应关关系系十进制数二进制数八进制数十六进制数0123456789101112131415000000010010001101000101011001111000100110101011110011011

6、11011110123456710111213141516170123456789ABCDEF数制转换数制转换（1）二进制数转换为八进制数：将二进制数由小数点开始，整数部分向左，小数部分向右，每3位分成一组，不够3位补零，则每组二进制数便是一位八进制数。将N进制数按权展开，即可以转换为十进制数。(1)、二进制数与八进制数的相互转换、二进制数与八进制数的相互转换1 1 0 1 0 1 0.0 10 00 (152.2)8（2）八进制数转换为二进制数：将每位八进制数用3位二进制数表示。=011 111 100.010 110(374.26)8(2)、二进制数与十六进制数的相互转换、二进制数与十六进

7、制数的相互转换1 1 1 0 1 0 1 0 0.0 1 10 0 00 (1D4.6)16=1010 1111 0100.0111 0110(AF4.76)16 二进制数与十六进制数的相互转换，按照每4位二进制数对应于一位十六进制数进行转换。(3)、十进制数转换为二进制数、十进制数转换为二进制数采用的方法 ：将整数部分和小数部分分别进行转换。整数部分采用基数连除法，小数部分 采用基数连乘法。转换后再合并。2 44 余数 低位 2 22 0=K0 2 11 0=K1 2 5 1=K2 2 2 1=K3 2 1 0=K4 0 1=K5 高位 0.375 2 整数 高位 0.750 0=K1 0.

8、750 2 1.500 1=K2 0.500 2 1.000 1=K3 低位整数部分采用基数连除法，先得到的余数为低位，后得到的余数为高位。小数部分采用基数连乘法，先得到的整数为高位，后得到的整数为低位。所以：(44.375)10(101100.011)2采用基数连除、连乘法，可将十进制数转换为任意的N进制数。用一定位数的二进制数来表示十进制数码、字母、符号等信息称为编码。用以表示十进制数码、字母、符号等信息的一定位数的二进制数称为代码。数字系统只能识别0和1，怎样才能表示更多的数码、符号、字母呢？用编码可以解决此问题。二-十进制代码：用4位二进制数b3b2b1b0来表示十进制数中的 0 9

9、十个数码。简称BCD码。2421码的权值依次为2、4、2、1；余3码由8421码加0011得到；格雷码是一种循环码，其特点是任何相邻的两个码字，仅有一位代码不同，其它位相同。用四位自然二进制码中的前十个码字来表示十进制数码，因各位的权值依次为8、4、2、1，故称8421 BCD码。11.1.3 编码编码常常用用B BC CD D码码十进制数 8421码 余3码 格雷码 2421码5421码01234567890000000100100011010001010110011110001001001101000101011001111000100110101011110000000001001100

10、1001100111010101001100110100000001001000110100101111001101111011110000000100100011010010001001101010111100权842124215421获得高、低电平的基本方法：利用半导体开关元件的导通、截止（即开、关）两种工作状态。逻辑0和1：电子电路中用高、低电平来表示。逻辑门电路：用以实现基本和常用逻辑运算的电子电路。简称门电路。基本和常用门电路有与门、或门、非门（反相器）、与非门、或非门、与或非门和异或门等。11.2.1 基本逻辑关系及其门电路基本逻辑关系及其门电路1 1、与逻辑和与门电路与逻辑和与门

11、电路当决定某事件的全部条件同时具备时，结果才会发生，这种因果关系叫做与逻辑。实现与逻辑关系的电路称为与门。+UCC(+5V)R F D1A D2B3V0VABF&uA uBuFD1 D20V 0V0V 3V3V 0V3V 3V0V0V0V3V导通 导通导通 截止截止 导通截止 截止A BF0 00 11 01 10001逻辑与（逻辑乘）的运算规则为：111 001 010 000ABCF与门的输入端可以有多个。下图为一个三输入与门电路的输入信号A、B、C和输出信号F的波形图。2 2、或逻辑和或门电路或逻辑和或门电路在决定某事件的条件中，只要任一条件具备，事件就会发生，这种因果关系叫做或逻辑。实

12、现或逻辑关系的电路称为或门。A D1B D2 3V 0V FRABF 1uA uBuFD1 D20V 0V0V 3V3V 0V3V 3V0V3V3V3V截止 截止截止 导通导通 截止导通 导通A BF0 00 11 01 10111F=A+B逻辑或（逻辑加）的运算规则为：111 001 010 000或门的输入端也可以有多个。下图为一个三输入或门电路的输入信号A、B、C和输出信号F的波形图。ABCF3 3、非逻辑和非门电路非逻辑和非门电路决定某事件的条件只有一个，当条件出现时事件不发生，而条件不出现时，事件发生，这种因果关系叫做非逻辑。实现非逻辑关系的电路称为非门，也称反相器。A+3V F电路

13、图1逻辑符号AFRCRBAF0110AF 输入A为高电平1(3V)时，三极管饱和导通，输出F为低电平0（0V)；输入A为低电平0(0V)时，三极管截止，输出F为高电平1（3V)。逻辑非（逻辑反）的运算规则为：01 104 4、复合门电路复合门电路将与门、或门、非门组合起来，可以构成多种复合门电路。AB&F(b)逻辑符号ABF&1(a)与非门的构成ABF 由与门和非门构成与非门。（1 1）与非门与非门A BF0 00 11 01 11110AB1F(b)逻辑符号ABF11(a)或非门的构成由或门和非门构成或非门。BAF（2 2）或）或非门非门A BF0 00 11 01 1100011.2.2

14、集成门电路集成门电路1 1、TTL与非门与非门ABR1V2V1F+UCC+5VR2 ABR1+UCC+5VV2FR2（1）当输入端有一个或几个接低电平0时（假设为0.3V），V1导通，基极电位被钳制在1V左右，不足以使V1的集电结和V2导通，V2截止，输出端F为高电平1。（2）输入信号全为高电平1时（假设为3V），V1的基极电位大约在1.4V左右，所以V1的几个发射结都处于反向偏置而截止，电流将通过电阻R1和V1的集电结向V2提供足够大的基极电流，使V2饱和导通，输出端F为低电平0。可见如图11.10所示电路的输入、输出满足与非逻辑关系，是与非门。如果某些输入端悬空，因不能构成通路，所以，悬空

15、输入端所产生的逻辑效果与该输入端加高电平时一样。ABR1V2V1F+UCC+5VR2 ABR1+UCC+5VV2FR2BAFA BF0 00 11 01 11110真值表真值表逻辑表达式：逻辑表达式：(b)74LS20 的引脚排列图&1 2 3 4 5 6 7 14 13 12 11 10 9 8电源地(a)74LS00 的引脚排列图 电源 1 2 3 4 5 6 7&14 13 12 11 10 9 8地内含4个两输入端的与非门，电源线及地线公用。内含两个4输入端的与非门，电源线及地线公用。将门电路按照一定的规律连接起来，可以组成具有各种逻辑功能的逻辑电路。分析和设计逻辑电路的数学工具是逻辑

16、代数（又叫布尔代数或开关代数）。逻辑代数具有3种基本运算：与运算（逻辑乘）、或运算（逻辑加）和非运算（逻辑非）。11.3.1 逻辑代数的公式和定理逻辑代数的公式和定理与运算：111 001 010 000（2）基本运算或运算：111 101 110 000非 运 算：10 01（1）常量之间的关系与运算：0 1 00AA AAAAAA或运算：1 11 0AA AAAAAA非运算：AA 分别令分别令A=0及及A=1代入这些公式，即代入这些公式，即可证明它们的正确性。可证明它们的正确性。（3）基本定理交换律：ABBAABBA结合律：)()()()(CBACBACBACBA分配律：)()()(CAB

17、ACBACABACBA反演律（摩根定律）：BABABABA.利用真值表很容易证利用真值表很容易证明这些公式的正确性。明这些公式的正确性。如证明如证明AB=BA：A B A.B B.A0 00 11 01 100010001(A+B)(A+C)=AA+AB+AC+BC分配率分配率A(B+C)=AB+ACA(B+C)=AB+AC=A+AB+AC+BCAA=AAA=A=A(1+B+C)+BC分配率分配率A(B+C)=AB+ACA(B+C)=AB+AC=A+BCA+1=1A+1=1证明分配率：A+BA=(A+B)(A+C)证明：证明：吸收律：ABABAABABA)()(证 明：)(BAAABAABAB

18、AABABAAABAAABAA)()()(1BA BA 分配率分配率A+BC=(A+B)(A+C)A+BC=(A+B)(A+C)A+A=1A+A=1A A1=11=1逻辑函数有5种表示形式：真值表、逻辑表达式、卡诺图、逻辑图和波形图。只要知道其中一种表示形式，就可转换为其它几种表示形式。11.3.2 逻辑函数的表示方法逻辑函数的表示方法1 1、真值表真值表真值表：是由变量的所有可能取值组合及其对应的函数值所构成的表格。真值表列写方法：每一个变量均有0、1两种取值，n个变量共有2i种不同的取值，将这2i种不同的取值按顺序（一般按二进制递增规律）排列起来，同时在相应位置上填入函数的值，便可得到逻辑

19、函数的真值表。例如：当A、B取值相同时，函数值为0；否则，函数取值为1。A BF0 00 11 01 101102 2、逻辑表达式逻辑表达式逻辑表达式：是由逻辑变量和与、或、非3种运算符连接起来所构成的式子。表达式列写方法：将那些使函数值为1的各个状态表示成全部变量（值为1的表示成原变量，值为0的表示成反变量）的与项（例如A=0、B=1时函数F的值为1，则对应的与项为AB）以后相加，即得到函数的与或表达式。BABAFA BF0 00 11 01 101103 3、逻辑图逻辑图逻辑图：是由表示逻辑运算的逻辑符号所构成的图形。FF&1&ABBC4 4、波形、波形图图波形图：是由输入变量的所有可能取

20、值组合的高、低电平及其对应的输出函数值的高、低电平所构成的图形。FFF11.3.3 逻辑函数的化简逻辑函数的化简BCCBCBBCCBBCAACBBCAABCY)()(1ABCBCABCAABCCBAABCCABAABCY)()(2运用摩根定律运用分配律运用分配律逻辑函数化简的意义：逻辑表达式越简单，实现它的电路越简单，电路工作越稳定可靠。BAFEBCDABAY)(1BABCDBADABADBCDABADCDBAY)()(2。运用摩根定律CABCABABCBAABCBCAABY)(DCBADBACBADBACBADBACCBADCBDCACBAY)()(。CACBBABBCAACBCBACBAB

21、CACBACBACBBACCBACBAACBBABACBCBBAY)()1()1()()(BCACABBCAABCCBAABCCABABCBCACBACABABCY)()()(：输出仅由输：输出仅由输入决定，与电路当前状态无入决定，与电路当前状态无关；电路结构中关；电路结构中无无反馈环路反馈环路（无记忆）。（无记忆）。ABCY&11.4.1 组合逻辑电路的分析组合逻辑电路的分析逻辑图逻辑图逻辑表逻辑表达式达式 1 1 最简与或最简与或表达式表达式 2 ABY 1BCY 2CAY 31Y2Y3YY 2 CABCABYACBCABYYYY 321A B CY0 0 00 0 10 1 00 1 1

22、1 0 01 0 11 1 01 1 100010111最简与或最简与或表达式表达式 3 真值表真值表CABCABY 3 4 电路的逻电路的逻辑功能辑功能当输入A、B、C中有2个或3个为1时，输出Y为1，否则输出Y为0。所以这个电路实际上是一种3人表决用的组合电路：只要有2票或3票同意，表决就通过。4 Y31111ABCYY1Y21逻辑图逻辑图BBACBABYYYYBYXYBAYCBAY213321逻辑表逻辑表达式达式BABBABBACBAY最简与或最简与或表达式表达式真值表真值表A B CY0 0 00 0 10 1 00 1 11 0 01 0 11 1 01 1 111111100ABC

23、Y&用与非门实现用与非门实现电路的输出Y只与输入A、B有关，而与输入C无关。Y和A、B的逻辑关系为：A、B中只要一个为0，Y=1；A、B全为1时，Y=0。所以Y和A、B的逻辑关系为与非运算的关系。电路的逻辑功能电路的逻辑功能ABBAY11.4.2 组合逻辑电路的设计组合逻辑电路的设计真值表真值表电路功电路功能描述能描述：用与非门设计一个交通报警控制电路。交通信号灯有红、绿、黄3种，3种灯分别单独工作或黄、绿灯同时工作时属正常情况，其他情况均属故障，出现故障时输出报警信号。设红、绿、黄灯分别用A、B、C表示，灯亮时其值为1，灯灭时其值为0；输出报警信号用F表示，灯正常工作时其值为0，灯出现故障时

24、其值为1。根据逻辑要求列出真值表。1 1 A B CFA B CF0 0 00 0 10 1 00 1 110001 0 01 0 11 1 01 1 10111 2 逻辑表达式逻辑表达式最简与或最简与或表达式表达式 3 2 4 逻辑变换逻辑变换ABCCABCBACBAF 3 ACABCBABBACCCABCBACBAABCCABABCCBAF)()(4 ACABCBAF 5 逻辑电路图逻辑电路图ACABCBAF 5 ABCF&111真值表真值表电路功电路功能描述能描述：用与非门设计一个举重裁判表决电路。设举重比赛有3个裁判，一个主裁判和两个副裁判。杠铃完全举上的裁决由每一个裁判按一下自己面前

25、的按钮来确定。只有当两个或两个以上裁判判明成功，并且其中有一个为主裁判时，表明成功的灯才亮。设主裁判为变量A，副裁判分别为B和C；表示成功与否的灯为Y，根据逻辑要求列出真值表。1 1 A B CYA B CY0 0 00 0 10 1 00 1 100001 0 01 0 11 1 01 1 10111 2 ABCCABCBAY 2 逻辑表达式逻辑表达式ABACY&3 最简与或最简与或表达式表达式 4 5 逻辑变换逻辑变换逻辑电逻辑电路图路图 3 4 5 ACABYACABBBACCCABCBAABCCABABCABCCABCBAY)()(组合逻辑部件是指具有某种逻辑组合逻辑部件是指具有某种逻

26、辑功能的中规模集成组合逻辑电路芯功能的中规模集成组合逻辑电路芯片。常用的组合逻辑部件有加法器、片。常用的组合逻辑部件有加法器、数值比较器、编码器、译码器、数数值比较器、编码器、译码器、数据选择器和数据分配器等。据选择器和数据分配器等。1、半加器、半加器11.5.1 加法器加法器能对两个1位二进制数进行相加而求得和及进位的逻辑电路称为半加器。半加器真值表Ai BiSi Ci0 00 11 01 10 01 01 00 1iiiiiiiiiiBACBABABAS=1&AiBiSiCiAiBiSiCiCO半加器符号半加器电路图加数本位的和向高位的进位2、全加器、全加器能对两个1位二进制数进行相加并考

27、虑低位来的进位，即相当于3个1位二进制数相加，求得和及进位的逻辑电路称为全加器。Ai Bi Ci-1Si Ci0 0 00 0 10 1 00 1 11 0 01 0 11 1 01 1 10 01 01 00 11 00 10 11 1Ai、Bi：加数，Ci-1：低位来的进位，Si：本位的和，Ci：向高位的进位。iiiiiiiiiiiiiiiiiiiiBACBABACBABABACBACBAC1111)()(11111111111)()()()(iiiiiiiiiiiiiiiiiiiiiiiiiiiiiiiiCBACBACBACBCBACBCBACBACBACBACBASiiiiiiBACB

28、AC1)(全加器的逻辑图和逻辑符号全加器的逻辑图和逻辑符号=1&AiBiCi-1SiCi 逻辑图图2-2-3 全加器的逻辑图和符号&=11iiiiCBASAiBiCi-1SiCiCI CO逻辑符号实现多位二进制数相加的电路称为加法器。串行进位加法器串行进位加法器：把n位全加器串联起来，低位全加器的进位输出连接到相邻的高位全加器的进位输入。C3 S3 C2 S2 C1 S1 C0 S0C0-1A3 B3 A2 B2 A1 B1 A0 B0COCOCOCOCICICICI：进位信号是由低位向高位逐级传递的，速度不高。为了提高运算速度，在逻辑设计上采用超前进位的方法，即每一位的进位根据各位的输入同时

29、预先形成，而不需要等到低位的进位送来后才形成，这种结构的多位数加法器称为超前进位加法器。11.5.2 数值比较器数值比较器用来完成两个二进制数的大小比较的逻辑电路称为数值比较器。设AB时L11；AB时L21；AB时L31。得1位数值比较器的真值表。A BL1(AB)L2(AB)L3(A=B)L1(AB)&逻逻辑辑表表达达式式逻逻辑辑图图11.5.3 编码器编码器实现编码操作的电路称为编码器。输入输 出Y2 Y1 Y0I0I1I2I3I4I5I6I70 0 00 0 10 1 00 1 11 0 01 0 11 0 01 1 11、3位二进制编码器位二进制编码器输输入入8个互斥的信号个互斥的信号

30、输输出出3位二进制代码位二进制代码真真值值表表753175310763276321765476542IIIIIIIIYIIIIIIIIYIIIIIIIIYI7I6I5I4 I3I2 I1 I0Y2 Y1 Y0I7I6I5I4 I3I2 I1 I0Y2 Y1 Y0(a)由或门构成(b)由与非门构成111&逻逻辑辑表表达达式式逻辑图逻辑图输 入I输 出Y3 Y2 Y1 Y00(I0)1(I1)2(I2)3(I3)4(I4)5(I5)6(I6)7(I7)8(I8)9(I9)0 0 0 00 0 0 10 0 1 00 0 1 10 1 0 00 1 0 10 1 1 00 1 1 11 0 0 01

31、 0 0 12、8421 码编码器码编码器输输入入10个互斥的数码个互斥的数码输输出出4位二进制代码位二进制代码真真值值表表9753197531076327632176547654298983IIIIIIIIIIYIIIIIIIIYIIIIIIIIYIIIIY逻辑表达式逻辑表达式I9 I8 I7I6I5I4 I3I2 I1 I0Y3 Y2 Y1 Y0(a)由或门构成1111I9 I8 I7I6I5I4 I3I2 I1 I0(b)由与非门构成Y3 Y2 Y1 Y0&逻辑图逻辑图3、3位二进制优先编码器位二进制优先编码器在优先编码器中优先级别高的信号排斥级别低的，即具有单方面排斥的特性。设I7的优

32、先级别最高，I6次之，依此类推，I0最低。输 入I7 I6 I5 I4 I3 I2 I1 I0输 出Y2 Y1 Y010 10 0 10 0 0 1 0 0 0 0 1 0 0 0 0 0 1 0 0 0 0 0 0 1 0 0 0 0 0 0 0 11 1 11 1 01 0 11 0 00 1 10 1 00 0 10 0 0真真值值表表12463465671234567345675677024534567234567345676771456745675676772IIIIIIIIIIIIIIIIIIIIIIIIIIYIIIIIIIIIIIIIIIIIIIIIIYIIIIIIIIIIIII

33、IY逻辑表达式逻辑表达式逻辑图逻辑图111111&1&Y2 Y1 Y0I7 I6 I5 I4 I3 I2 I1 I08线线-3线线优优先先编编码码器器如果要求输出、输入均为反变量，则只要在图中的每一个输出端和输入端都加上反相器就可以了。11.5.4 译码器译码器译码器就是把一种代码转换为另一种代码的电路。把代码状态的特定含义翻译出来的过程称为译码，实现译码操作的电路称为译码器。设二进制译码器的输入端为n个，则输出端为2n个，且对应于输入代码的每一种状态，2n个输出中只有一个为1（或为0），其余全为0（或为1）。二进制译码器可以译出输入变量的全部状态，故又称为变量译码器。1、二进制译码器、二进制

34、译码器3位二进制译码器位二进制译码器A2 A1 A0Y0 Y1 Y2 Y3 Y4 Y5 Y6 Y70 0 00 0 10 1 00 1 11 0 01 0 11 1 01 1 11 0 0 0 0 0 0 00 1 0 0 0 0 0 00 0 1 0 0 0 0 00 0 0 1 0 0 0 00 0 0 0 1 0 0 00 0 0 0 0 1 0 00 0 0 0 0 0 1 00 0 0 0 0 0 0 1真值表真值表输输入入：3位二进制代码位二进制代码输输出出：8个互斥的信号个互斥的信号01270126012501240123012201210120AAAYAAAYAAAYAAAYA

35、AAYAAAYAAAYAAAY&111 A2 A1 A0 Y7 Y6 Y5 Y4 Y3 Y2 Y1 Y0逻辑表达式逻辑表达式逻辑图逻辑图电路特点电路特点：与门组成的阵列：与门组成的阵列3 线-8 线译码器二-十进制译码器的输入是十进制数的4位二进制编码（BCD码），分别用A3、A2、A1、A0表示；输出的是与10个十进制数字相对应的10个信号，用Y9Y0表示。由于二-十进制译码器有4根输入线，10根输出线，所以又称为4线-10线译码器。2、8421 码译码器码译码器把二-十进制代码翻译成10个十进制数字信号的电路，称为二-十进制译码器。A3 A2 A1 A0Y9 Y8 Y7 Y6 Y5 Y4

36、Y3 Y2 Y1Y00 0 0 00 0 0 10 0 1 00 0 1 10 1 0 00 1 0 10 1 1 00 1 1 11 0 0 01 0 0 10 0 0 0 0 0 0 0 0 10 0 0 0 0 0 0 0 1 00 0 0 0 0 0 0 1 0 00 0 0 0 0 0 1 0 0 00 0 0 0 0 1 0 0 0 00 0 0 0 1 0 0 0 0 00 0 0 1 0 0 0 0 0 00 0 1 0 0 0 0 0 0 00 1 0 0 0 0 0 0 0 01 0 0 0 0 0 0 0 0 0真值表真值表012390123801237012360123

37、50123401233012320123101230 AAAA YAAAAYAAAA YAAAAYAAAA YAAAAYAAAA YAAAAYAAAA YAAAAY A0 A1 A2 A3 Y0 Y1 Y2 Y3 Y4 Y5 Y6 Y7 Y8 Y91111&逻辑表达式逻辑表达式逻辑图逻辑图abcdefgh a b c d a f b e f g h g e c d(a)外形图(b)共阴极(c)共阳极+VCCabcdefgh3、显示译码器、显示译码器数数码码显显示示器器用来驱动各种显示器件，从而将用二进制代码表示的数字、文字、符号翻译成人们习惯的形式直观地显示出来的电路，称为显示译码器。b=c=

38、f=g=1，a=d=e=0时时c=d=e=f=g=1，a=b=0时时共阴极共阴极显示译码器真值表显示译码器真值表真值表仅适用于共阴极真值表仅适用于共阴极LED输 入输 出A3 A2 A1 A0a b c d e f g显示字形0 0 0 00 0 0 10 0 1 00 0 1 10 1 0 00 1 0 10 1 1 00 1 1 11 0 0 01 0 0 11 1 1 1 1 1 00 1 1 0 0 0 01 1 0 1 1 0 11 1 1 1 0 0 10 1 1 0 0 1 11 0 1 1 0 1 10 0 1 1 1 1 11 1 1 0 0 0 01 1 1 1 1 1 1

39、1 1 1 0 0 1 111.5.5 4选选1数据选择器数据选择器输 入 D A1 A0输 出 YD0 0 0D1 0 1D2 1 0D3 1 1 D0 D1 D2 D3013012011010AADAADAADAADY真值表真值表逻辑表达式逻辑表达式地地址址变变量量输输入入数数据据由地址码决定从路输入中选择哪路输出。逻辑图逻辑图1111D0 D1 D2 D3A1A0&1Y11.5.6 1路路-4路数据分配器路数据分配器由地址码决定将输入数据送给哪路输出。输 入输出A1 A0Y0 Y1 Y2 Y3D0 00 11 01 1D 0 0 00 D 0 00 0 D 00 0 0 D真值表真值表逻辑表达式逻辑表达式地地址址变变量量输输入入数数据据013012011010 ADAYADAYAADYAADY逻辑图逻辑图11DA1 A0Y0 Y1 Y2 Y3&013012011010 ADAYADAYAADYAADY